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可测性设计工程师(DFT)
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可测性设计工程师(DFT)西安紫光国芯半导体有限公司西安-高新技术产业开发区1-2万/月04-05

学历要求:本科|工作经验:1年|公司性质:国企|公司规模:

职责: 1. 参与SoC级DFT架构定义。 2. 与设计团队合作,实施SoC芯片的DFT策略 3.实现基本的DFT方案,包括扫描、边界扫描、MemBIST和LogicBIST。 4. 开发高覆盖率和低成本的测试模式。 5. 使用仿真和静态时序分析工具验证所有DFT逻辑和测试模式。 6. 支持其他团队解决与DFT相关的问题。 任职资格: 1. 本科或硕士学历,2年以上相关工作经验。 2. 具备IC设计流程的基本知识,包括编码、仿真、验证、合成和STA 3.良好的理解一般的DFT方法,如BIST, SCAN,JTAG和ATPG。 4. 了解并熟悉基本的Mentor/ Synopsys DFT流程和工具 5. 精通Verilog/VHDL语言 6. 熟悉Shell/TCL/Perl程序,或熟练使用C语言 7. 良好的英语沟通能力 8. 工作积极主动,有良好的团队合作精神

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资深DFT(可测性设计)工程师芯原微电子(成都)有限公司成都-高新区04-03

学历要求:硕士|工作经验:2年|公司性质:外资(欧美)|公司规模:150-500人

职位描述:完成DFT测试方案的制定;完成DFT逻辑设计,包括:存储器内建自测试、存储器内建自修复、扫描链插入、边界扫描链插入、宏测试;完成DFT测试向量的验证;完成DFT模式时序约束,帮助DFT模式时序收敛;帮助芯片Bring-up,完成测试向量的调试,良率的提升;为客户、现场应用工程师、销售人员提供技术支持。职位要求:电子工程硕士及以上学历,至少2年DFT工作经验;或者电子工程学士学历,至少5年DFT工作经验;具备以下经验:测试方案的制定,存储器内建自测试、存储器内建自修复、扫描链插入、边界扫描链插入、宏测试的逻辑设计及验证,分析ATE测试向量的故障并做诊断;熟练使用Mentor/Synopsys DFT EDA工具;具备熟练英文读写能力和基本听说能力;富有事业心和团队合作精神,沟通表达能力良好;具备后端综合、布局布线、静态时序分析经验者优先。Responsibilities:Complete DFT test plan definition.Complete DFT logic design, including: memory BIST, memory BISR, scan insertion, boundary scan insertion, macro testing.Complete DFT test pattern verification.Complete DFT mode timing constraint, support DFT mode timing closure.Support chip bring-up, complete test pattern debugging, yield improvement.Provide technical support for customer/FAE/sales. Requirements:Master of EE, 2+ years' DFT work experiences or Bachelor of EE, 5+ years' DFT work experiences.Have following experiences: test plan definition, memory BIST, memory BISR, scan insertion, boundary scan insertion, macro testing logic design and verification, analyze ATE test pattern failure and perform diagnose.Have back-end Synthesis, P&R, STA experiences is a plus.Be able to skillfully use the Mentor/Synopsys DFT EDA tools.Full of enterprise and the spirit of teamwork, good ability to communicate and express, fluent in Mandarin and English.

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可测性设计工程师(DFT)西安紫光国芯半导体有限公司西安-雁塔区1-2万/月03-31

学历要求:本科|工作经验:2年|公司性质:国企|公司规模:150-500人

岗位职责:Responsibilities:1. Participate in SoC level DFT architecture definition.2. Implement DFT strategy for the SoC chips, cooperating with design team3. Implement basic DFT schemes, including scan, boundary scan, MemBIST and LogicBIST.4. Develop the high coverage and cost effective test patterns.5. Verify all DFT logics and test patterns with simulation and static timing analysis tool.6. Support other teams for DFT related problems.  任职资格:Requirements:1. Either Bachelor or Master degree, 2+ years related experience required.2. Basic knowledge of IC design flow, including coding, simulation, verification, synthesis and STA3. Good understanding of the General DFT methodology such as BIST, SCAN,JTAG and ATPG.4. Knowledge on and familiar with basic Mentor/ Synopsys DFT flow and tools5. Proficient in Verilog/VHDL language6. Be familiar with Shell/TCL/Perl program, or skilled in C program7. Good English communication skills8. Self-motivated and good team player

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可测性设计工程师2019RD01瑞晟微电子(苏州)有限公司苏州0.6-1.5万/月03-31

学历要求:本科|工作经验:2年|公司性质:外资(非欧美)|公司规模:500-1000人

岗位职责:负责Design-For-Test (Scan/MBIST)、Function/DFT/STA Verification、Advanced Flow Development任职要求 :1. 熟悉Verilog RTL Design、Simulation、Synthesis、STA、Scan/ATPG等相关DFT Design Flow 2. 有DCG-SPG Flow、Memory BIST、Back-end Flow、Low Power Flow、Constraint Integration相关经验佳

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IC Frontend design engineer(芯片前端设计工程师)台积电(南京)有限公司南京04-05

学历要求:硕士|工作经验:|公司性质:外资(非欧美)|公司规模:

职责范围:数字芯片的前端设计实现,其中包含:综合(SYN)、可测性设计(DFT)、存储器内建自测试(MBIST)、形式验证(Formal)、连接完整性验证(Linting)等。大规模数字芯片前端设计流程和设计方法学的开发、完善与创新、与后端合作解决先进工艺节点下因物理极限带来的挑战。RTL/门级网表仿真。时序约束文件的编写,优化与验证,协助时序收敛和芯片顺利投产。支援客户项目。 职位要求:电子、计算机等相关专业,硕士及以上学历的应届毕业生。具备基本RTL读写与仿真能力。熟悉使用一种或多种IC前端工具(综合、可测性设计、存储器内建自测试、形式验证、静态时序分析)者优先。具备数字集成电路设计背景和熟悉静态时序分析者优先。熟悉TCL/Perl/Python一种或多种者语言者优先。

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ATE工程师上海傅硅电子科技有限公司上海-徐汇区1.5-2.5万/月04-05

学历要求:本科|工作经验:1年|公司性质:创业公司|公司规模:少于50人

岗位职责:1. 与芯片研发工程师沟通芯片的可测性设计;2. 设计CP、FT测试电路板,搭建ATE测试平台,与厂商合作制作Load Board、Probe Card、Socket等测试硬件;3. 根据测试规范,开发测试程序、工程验证、调试、测试程序确认报告;4. 对测试程序不断分析与优化,确保测试覆盖率、测试稳定性、一致性以及测试时间达到预期目标,并提高测试效率;5. 协助生产线顺利生产,与其它相关部门进行沟通和互动,完成上级交给工作任务,以达到保证产品质量,降低制造成本的目标;6. 测试程式版本管理及批量生产的管理。任职要求:1.  微电子,自动化等相关专业,本科以上学历;2.  1年以上IC测试开发工作经验;3.    有Chroma&CTA8280&ACCO8200测试开发经验优先;4. 具备模拟电路和PCB设计经验;5. 良好的C/C++/C#编程能力;6. 工作负责,做事积极主动,学习能力强,能够吃苦耐劳;7. 良好的人际沟通协调能力,富有团队精神。

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DFT Engineer灿芯半导体(上海)有限公司苏州-工业园区0.8-2.5万/月04-05

学历要求:本科|工作经验:2年|公司性质:外资(非欧美)|公司规模:150-500人

1. Implement DFT structures (internal-scan (stuck-at, at-speed), JTAG, MBIST, hard IP testing structure) in complex SOC design 2. Generating, simulation and debugging the test patterns for ATE manufacture testing 3. Interface with back-end physical design team to complete timing closure for test related logic 4. Interface with operation team to debug production test-vectors for wafer test and final testJob Requirements:1. BS or MS, major in EE or related discipline 2. Strong experience in ASIC logic design and verification 3. 2+ years work experience in ASIC DFT design4. Logical thinking and sensitive to the problem with good self-study and problem shooting ability5. Good communication capability and teamwork spirit        

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模拟 IC电路设计工程师广东高云半导体科技股份有限公司济南-高新区1-2万/月04-05

学历要求:本科|工作经验:5-7年|公司性质:民营公司|公司规模:150-500人

岗位职责:负责设计开发和调试嵌入式内存存储器和相关电路任职要求:1.具有良好的CMOS集成电路设计的基础知识2.对CMOS集成电路生产工艺有一定认识3.有良好的数字电路Verilog设计知识4.了解内存存储器设计相关知识5.了解内存存储器电路设计流程、参数提取、噪声与干扰分析,良率改进和可测性设计DFT等6.会使用Tcl或者Perl脚本7.会使用Cadence Virtuoso、Hspice、Hsim等设计仿真软件8.从事过内存存储器设计或者相关Verilog仿真者优先。

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测试/测试开发实习生 — 有转正机会字节跳动深圳0.9-1.8万/月04-05

学历要求:本科|工作经验:在校生/应届生|公司性质:民营公司|公司规模:10000人以上

职位描述:1、参与头条相关产品的研发与测试过程;2、参与产品需求、功能设计、产品可测性设计与反馈,致力于提高产品的技术可靠性和用户体验。职位要求:1、计算机相关专业;2、有移动互联网测试经验,有自动化或白盒测试经验优先考虑;3、热爱互联网,对互联网相关业务或技术充满好奇及热情;?4、具备快速的产品及业务学习能力、敏捷而周到的逻辑思维能力;5、每周可实习4天以上,可实习3个月以上。

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SoC设计工程师/SoC验证工程师(上海)深圳市维新教育科技有限公司异地招聘2.5-5万/月04-05

学历要求:本科|工作经验:|公司性质:民营公司|公司规模:50-150人

SoC设计工程师岗位职责:1、参与SoC Spec定义、定制芯片架构;2、负责IP的设计实现、可测性设计、形式验证、系统集成、芯片测试支持;3、配合其他工程师完成FPGA平台开发。任职要求:1、电子信息、微电子类专业等相关专业硕士;2、精通Verilog和System Verilog,熟练使用EDA仿真及调试工具;3、熟悉C/C++,3年以上SOC芯片前端设计经验、熟悉ARM、AMBA等;4、良好的文档编写能力;5、具有RFID芯片设计经验者优先;6、具有flash接口、具有ARM协处理器接口设计经验者优先;7、具有RSA/ECC加密模块设计经验者优先;8、具有低功耗设计经验者优先。SoC验证工程师岗位职责 :1、负责SoC 顶层、或IP集成验证、软硬件协同验证平台建设;2、制定全功能覆盖验证计划;3、Formality Verification、STA及post-simulaiton;4、开发FPGA原型平台系统;任职要求:1、电子信息、微电子类专业等相关专业硕士;2、精通verilog、System Verilog、C/C++;3、熟悉基于ARM核的SoC 编程;4、熟悉ARM结构,精通AMBA总线协议、具有C/C++编程及调试经验;5、具有VMM/OVM/UVM验证经验;6、具有RSA/ECC加密模块验证经验者优先;7、3年以上SoC开发、验证相关工作经验。地址:上海市浦东新区张江园区

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数字芯片设计工程师3116紫光展锐重庆-渝北区1.5-3万/月04-05

学历要求:硕士|工作经验:2年|公司性质:外资(非欧美)|公司规模:1000-5000人

岗位职责:1、开发和维护block和SoC芯片DFT设计和实现; 2、规划mbist,stuck at,at speed测试方案,深入理解每种测试方案的原理;3、与STA工程师合作,解决测试模式的sdc和timing相关问题;4、与ATE测试工程师合作,解决量产测试相关问题;5、独立完成ATPG 验证; 任职资格:1、电子,通信或计算机等关联专业硕士及以上学历;2、有2年以上DFT工作经验;熟悉ASIC设计;3、熟练使用Synopsys或Mentor DFT工具;4、能够熟练使用 Perl(Python)、Tcl 和 Shell 脚本优先;5、具有28nm及以下制程ASIC流程相关经验者优先;6、具有repair 量产经验优先;

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测试工程师网易集团杭州1.5-2万/月04-05

学历要求:本科|工作经验:2年|公司性质:上市公司|公司规模:10000人以上

Responsibility1、参与产品的设计与测试过程:产品需求,功能设计,产品可测性设计与反馈,单元测试,系统测试,性能测试,产品效果评估评测等多方面,全流程的保证产品质量; 2、参与构建研发体系的持续集成环境及自动化测试平台的研发,参与产品线特色化的测试框架; 3、参与数据平台的测试工作,在保证高质量交付的同时加速软件的发布周期。提升单元测试效率,通过性能测试和监控工具来精确预估线上系统表现;Requirements1、本科及以上学历,3年以上网站或Web测试经验,熟悉web测试基本方法、流程,熟悉B/S架构的软件测试流程; 2、熟悉软件测试的技术和方法,能够独立编写测试计划,测试用例,执行测试过程,完成测试报告; 3、对软件测试有浓厚的兴趣和丰富的经验,有很强的分析能力和定位问题的能力; 4、能熟练使用sql增删改查语句,对数据仓库、关系型数据库有较为扎实的基础;5、熟悉Python或Java等一门编程语言,有selenium自动化测试、Jmeter性能测试测试、接口测试经验者优先考虑; 6、有数据分析测试相关经验优先;有测试leader经验优先。

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业务平台事业部-高级测试开发专家-杭州阿里巴巴集团杭州04-05

学历要求:本科|工作经验:8-9年|公司性质:上市公司|公司规模:10000人以上

1. 负责业务线级别的交付质量,制定和执行短期和中长期的质量保障和测试策略;2. 有预见性的进行架构、实施、资源、协同等多角度的风险评估,不断进行优化和风险防范;3. 推动架构、技术、工具和流程的改进和创新,多工种配合,提升整体研发和交付的效率;4. 身体力行,参与测试开发工程师的各项日常工作,践行工程师文化,提升测试团队专业技术能力;5. 参与合作伙伴测试能力建设。积极参与公司内和行业内的各类交流,推广***实践和技术创新。1. 计算机本科以上相关专业及8年以上工作经验,有丰富的大型软件项目经验;2. 具备扎实的计算机基础知识,熟练掌握至少一种主流编程语言和一种关系型数据库的开发;3. 具备较强的架构设计能力,对设计模式、可测性设计、防错与容灾等***实践有丰富的实践经验;5. 优秀的沟通和团队合作能力,能够在复杂的局面下带领团队分阶段拿到***结果;6. 有大数据、机器学习、算法、形式化验证、数据安全等领域经验者优先;7. 有电商平台或金融支付行业经验者优先,有在国内外一线互联网公司担任技术管理经验者优先。

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DFT工程师天津飞腾信息技术有限公司长沙04-04

学历要求:硕士|工作经验:|公司性质:国企|公司规模:

任职条件:1)熟悉Tessent / TetraMax / Synopsys / Mentor等可测性设计工具; 2)熟悉Verilog等硬件描述语言;熟练使用Perl、Tcl、Shell等脚本编程;3)了解集成电路设计,尤其是后端设计的一般方法;4)有相关开发经验,特别是流片经验者优先;有一定的PCB设计经验者优先;有对DFT设计(包括scan、mbist、jtag等)实际项目经验的优先。专业要求:计算机、微电子、通信、自动化等相关专业。

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芯片设计类-DFT工程师(长沙)天津飞腾信息技术有限公司长沙04-04

学历要求:硕士|工作经验:|公司性质:民营公司|公司规模:

岗位描述:设计和验证整芯片的DFT设计;产生测试向量,整理测试文档,配合ATE工程师调试,并解决测试过程中的问题;改善芯片的测试设计流程;支持芯片的可靠性考核涉及的向量;支持芯片故障分析。任职资格:☆计算机、微电子、通信、自动化等相关专业;☆硕士及以上学历;1)具备集成电路可测性设计的相关知识背景,最好具备可测性设计的经验或在校期间参与过相关课题;2)具备一定的可靠性物理、材料相关背景知识;3)熟悉Tessent / TetraMax / Synopsys / Mentor等可测性设计工具;4)熟悉Verilog等硬件描述语言;熟练使用Perl、Tcl、Shell等脚本编程;5)了解集成电路设计,尤其是后端设计的一般方法;6)有相关开发经验,特别是流片经验者优先;有一定的PCB设计经验者优先;有对DFT设计(包括scan、mbist、jtag等)实际项目经验的优先;7)服从工作任务安排,有良好的团队意识,具备较好的沟通、学习能力。

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硬件工程师助理深圳市优力特技术有限公司深圳-龙华新区4.5-6千/月04-04

学历要求:中专|工作经验:1年|公司性质:民营公司|公司规模:少于50人

1、懂产品硬件原理图、PCB的设计以及改进,硬件调试、测试等;2、懂产品可测性设计、硬件电路的互连方案设计、信号完整性分析以及实现(包括EMC/EMI);3、懂产品相关文档(如原理图、BOM文档等)的拟制及评审,协助产品的生产导入,准备工厂生产需要的相关技术性文档以及测试。

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数字IC设计工程师长沙海格北斗信息技术有限公司北京-海淀区2-3万/月04-03

学历要求:本科|工作经验:2年|公司性质:国企|公司规模:150-500人

岗位职责:1、根据系统需求,制定模块设计方案,微架构,模块RTL实现2、搭建模块仿真平台,完成仿真测试3、参与数字前端设计流程,配合后端工程师完成时序收敛及所有流片前的规则检查4、持续提升设计质量,包括面积,功耗,时序优化任职要求:1、精通Verilog设计语言,熟悉芯片设计方法学,精通低功耗设计,可靠和可测性设计2、熟悉主流EDA工具,理解逻辑综合、Floorplan、布局布线、时序分析、功耗分析等3、加分项:有成功流片经验,系统架构4、加分项:熟悉SystemVerilog/ UVM等验证知识,熟悉C/C++,熟悉脚本语言

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IC工程师中国人民解放军国防科技大学电子科学学院导航与时空技术工程研究中心长沙1.5-2万/月04-03

学历要求:本科|工作经验:2年|公司性质:事业单位|公司规模:150-500人

岗位职责:1、负责IC代码的编写、测试、烧制2、负责数字电路的规格定义、RTL代码编写、验证、综合、时序分析、可测性设计;3、负责进行电路设计、仿真以及总体布局和修改;4、制作IC芯片功能说明书;5、负责与版图工程师协作完成版图设计;6、提供技术支持。任职要求:1、具有一定的模拟电路基础,有数模混合电路设计经验;2、良好的电子电路分析能力;具有soc的设计和验证的经验;3、精通Verilog,Tcl,C,Perl等设计语言;4、具有团队协作和良好的沟通能力

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数字电路设计工程师凌阳成芯科技(成都)有限公司成都-高新区6-8千/月04-03

学历要求:本科|工作经验:无需经验|公司性质:外资(非欧美)|公司规模:150-500人

1.负责数字集成电路的设计和验证;2.负责进行电路RTL代码编写、仿真验证、综合、时序分析、可测性设计;3.指导设计测试方案,并协助对芯片样片进行测试评估;4.负责相关技术文档编写;5.负责解决其他集成、验证、测试中的问题。岗位要求1.熟悉数字IC设计流程;2.熟练Verilog、VHDL代码编写,具有良好的coding style;3.了解逻辑综合、静态时序分析、后端物理实现及形式验证等;4.熟悉VCS、NC-Verilog、verdi、DC、PT、TeraMax等EDA工具;5.英语四级或以上,具有阅读及编写英语技术文档的能力;6.主动性强,有责任心,做事认真仔细,良好的团队合作精神。

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DFT前端设计工程师Sytrons Technology Co.,Ltd. 思信电子科技有限公司异地招聘1-3万/月04-03

学历要求:本科|工作经验:1年|公司性质:合资|公司规模:150-500人

职位描述:1.负责SOC芯片Synthesis,Formal,STA;2.实现SOC可测试性设计包括JTAG,MBIST,SCAN CHAIN及ATPG;3.协助后端进行时序分析与收敛。岗位要求:1.微电子/通信类相关专业本科及以上学历;2.熟悉DFT相关流程及EDA工具;3.熟悉linux操作系统Job Dscription:1.Take charge of the SOC chip's Synthesis,Formal,STA work.2.Complete the SOC design for test work,include JTAG,MBIST,SCAN CHAIN and ATPG.3.Support the Backend to analysis and close the timing.Requirement:1.Majors in Micro Electronics or Telecommunication, Bachelor or above degree.2.Familiar with the DFT flow and EDA tools.3.Familiar with linux/unix

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